PCI - FPGA - Core
Der PCI-Bus ist fester Bestandteil vieler Systeme, mit dem sich verschiedenste Komponenten kommunikativ verbinden lassen. Der PCI-FPGA-Core beinhaltet eine Schnittstelle zum PCI-Bus und bietet dem Nutzer ein leicht anwendbares 32 bit Adress- und Datenbusinterface zum Datenaustausch.
Der Entwurf des Interface erfolgte unter Berücksichtigung der PCI-Spezifikationen 2.2 bzw. 2.3. Durch einen Parametersatz lässt sich der FPGA-Core parametrieren und der jeweiligen Anwendung anpassen. Der Core lässt sich in FPGA’s verschiedener Hersteller implementieren.
Zur Entwicklung eigener Applikationen stehen PCI-Evaluation-Boards auf Basis
der APA- bzw. A3P-Baustein-Familie von ACTELTM zur Verfügung.
APA - PCI - Evaluation - Board
Das APA-Board ist mit einem 5 V 32 bit PCI-Steckverbinder ausgestattet und kann mit einem APA075 oder Pin-kompatiblen größeren Baustein bestückt werden. Es verfügt über 1 Mbyte SRAM und Steckverbinder für Erweiterungen.
A3P - PCI - Evaluation - Board
Das A3P-Board besitzt einen Universal-Steckverbinder für 3,3 V- und 5 V 32 bit PCI-Slots. Es kann wahlweise mit A3P250, A3P400, A3P1000 oder auch mit A3PE600 bestückt werden. Alle freien PIN‘s sind auf Steckverbinder gelegt. Bei diesem Board ist es möglich, für eine „Bank“ die IO-Spannung einzustellen (3,3 V / 1,5 V oder User).
Eigenschaften des PCI-FPGA-Core
- 32 bit Interface
- 33 Mhz Taktrate (66 Mhz optional)
- konfigurierbar als PCI Target oder Master / Target
- 0 waitstate Burst Transfer
- User Interface mit 32 bit Adress- und Datenbus
- Interrupt Support
- 3 konfigurierbare Speicherbereiche (BAR 0 - 2)
- Expansion ROM Register
- konfigurierbares mehrkanaliges DMA Interface (nur bei Master / Target)
Anwendungen
- Aufrüstung bestehender ISA-Systeme auf PCI Bus
- Anbindung kundenspezifischer Schnittstellen an den PCI - Bus
- Integration des PCI - Bus - Cores in Ihr Anwendungsdesign
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Dipl.-Ing. (FH) Matthias Niwa
Leiter Forschung & Entwicklung
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